專業(yè)線路板貼片1. 從原理圖到PCB的設(shè)計(jì)流程建立元件參數(shù)——>輸入原理網(wǎng)表->設(shè)計(jì)參數(shù)設(shè)置->手工布局->手工布線->驗(yàn)證設(shè)計(jì)——>復(fù)查->CAM輸出。線路板貼片加工廠2. 參數(shù)設(shè)置相鄰導(dǎo)線間距必須能滿足電氣安全要求，而且為了便于操作和生產(chǎn)，間距也應(yīng)盡量寬些。最小間距至少要能適合承受的電壓，在布線密度較低時(shí)，信號(hào)線的間距可適當(dāng)?shù)丶哟?，?duì)高、低電平懸殊的信號(hào)線應(yīng)盡可能地短且加大間距，一般情況下將走線間距設(shè)為8mil。焊盤(pán)內(nèi)孔邊緣到印制板邊的距離要大于1mm，這樣可以避免加工時(shí)導(dǎo)致焊盤(pán)缺損。當(dāng)與焊盤(pán)連接的走線較細(xì)時(shí)，要將焊盤(pán)與走線之間的連接設(shè)計(jì)成水滴狀，這樣的好處是焊盤(pán)不容易起皮，而是走線與焊盤(pán)不易斷開(kāi)。3. 元器件布局實(shí)踐證明，即使電路原理圖設(shè)計(jì)正確，印制電路板設(shè)計(jì)不當(dāng)，也會(huì)對(duì)電子設(shè)備的可靠性產(chǎn)生不利影響。例如，如果印制板兩條細(xì)平行線靠得很近，則會(huì)形成信號(hào)波形的延遲，在傳輸線的終端形成反射噪聲;由于電源、地線的考慮不周到而引起的干擾，會(huì)使產(chǎn)品的性能下降，因此，在設(shè)計(jì)印制電路板的時(shí)候，應(yīng)注意采用正確的方法。每一個(gè)開(kāi)關(guān)電源都有四個(gè)電流回路：◆ 電源開(kāi)關(guān)交流回路◆ 輸出整流交流回路◆ 輸入信號(hào)源電流回路◆ 輸出負(fù)載電流回路輸入回路通過(guò)一個(gè)近似直流的電流對(duì)輸入電容充電，濾波電容主要起到一個(gè)寬帶儲(chǔ)能作用;類似地，輸出濾波電容也用來(lái)儲(chǔ)存來(lái)自輸出整流器的高頻能量，同時(shí)消除輸出負(fù)載回路的直流能量。所以，輸入和輸出濾波電容的接線端十分重要，輸入及輸出電流回路應(yīng)分別只從濾波電容的接線端連接到電源;如果在輸入/輸出回路和電源開(kāi)關(guān)/整流回路之間的連接無(wú)法與電容的接線端直接相連，交流能量將由輸入或輸出濾波電容并輻射到環(huán)境中去。電源開(kāi)關(guān)交流回路和整流器的交流回路包含高幅梯形電流，這些電流中諧波成分很高，其頻率遠(yuǎn)大于開(kāi)關(guān)基頻，峰值幅度可高達(dá)持續(xù)輸入/輸出直流電流幅度的5倍，過(guò)渡時(shí)間通常約為50ns。這兩個(gè)回路最容易產(chǎn)生電磁干擾，因此必須在電源中其它印制線布線之前先布好這些交流回路，每個(gè)回路的三種主要的元件濾波電容、電源開(kāi)關(guān)或整流器、電感或變壓器應(yīng)彼此相鄰地進(jìn)行放置，調(diào)整元件位置使它們之間的電流路徑盡可能短。

如果阻抗變化只發(fā)生一次，例如線寬從8mil變到6mil后，一直保持6mil寬度這種情況，要達(dá)到突變處信號(hào)反射噪聲不超過(guò)電壓擺幅的5%這一噪聲預(yù)算要求，阻抗變化必須小于10%。這有時(shí)很難做到，以 FR4板材上微帶線的情況為例，我們計(jì)算一下。如果線寬8mil，線條和參考平面之間的厚度為4mil，特性阻抗為46.5歐姆。線寬變化到6mil后特性阻抗變成54.2歐姆，阻抗變化率達(dá)到了20%。反射信號(hào)的幅度必然超標(biāo)。至于對(duì)信號(hào)造成多大影響，還和信號(hào)上升時(shí)間和驅(qū)動(dòng)端到反射點(diǎn)處信號(hào)的時(shí)延有關(guān)。但至少這是一個(gè)潛在的問(wèn)題點(diǎn)。幸運(yùn)的是這時(shí)可以通過(guò)阻抗匹配端接解決問(wèn)題。如果阻抗變化發(fā)生兩次，例如線寬從8mil變到6mil后，拉出2cm后又變回8mil。那么在2cm長(zhǎng)6mil寬線條的兩個(gè)端點(diǎn)處都會(huì)發(fā)生反射，一次是阻抗變大，發(fā)生正反射，接著阻抗變小，發(fā)生負(fù)反射。如果兩次反射間隔時(shí)間足夠短，兩次反射就有可能相互抵消，從而減小影響。假設(shè)傳輸信號(hào)為1V，第Y次正反射有0.2V被反射，1.2V繼續(xù)向前傳輸，第二次反射有 -0.2*1.2 = 0.24v被反射回。再假設(shè)6mil線長(zhǎng)度極短，兩次反射幾乎同時(shí)發(fā)生，那么總的反射電壓只有0.04V，小于5%這一噪聲預(yù)算要求。因此，這種反射是否影響信號(hào)，有多大影響，和阻抗變化處的時(shí)延以及信號(hào)上升時(shí)間有關(guān)。研究及實(shí)驗(yàn)表明，只要阻抗變化處的時(shí)延小于信號(hào)上升時(shí)間的20%，反射信號(hào)就不會(huì)造成問(wèn)題。如果信號(hào)上升時(shí)間為1ns，那么阻抗變化處的時(shí)延小于0.2ns對(duì)應(yīng)1.2英寸，反射就不會(huì)產(chǎn)生問(wèn)題。也就是說(shuō)，對(duì)于本例情況，6mil寬走線的長(zhǎng)度只要小于3cm就不會(huì)有問(wèn)題。

覆銅，就是將PCB上閑置的空間作為基準(zhǔn)面，然后用固體銅填充，這些銅區(qū)又稱為灌銅。敷銅的意義在于，減小地線阻抗，提高抗干擾能力;降低壓降，提高電源效率;還有，與地線相連，減小環(huán)路面積。如果PCB的地較多，有SGND、AGND、GND，等等，如何覆銅?我的做法是，根據(jù)PCB板面位置的不同，分別以最主要的“地”作為基準(zhǔn)參考來(lái)獨(dú)立覆銅，數(shù)字地和模擬地分開(kāi)來(lái)敷銅自不多言。同時(shí)在覆銅之前，首先加粗相應(yīng)的電源連線：V5.0V、V3.6V、V3.3V(SD卡供電)，等等。這樣一來(lái)，就形成了多個(gè)不同形狀的多變形結(jié)構(gòu)。覆銅需要處理好幾個(gè)問(wèn)題：一是不同地的單點(diǎn)連接，二是晶振附近的覆銅，電路中的晶振為一高頻發(fā)射源，做法是在環(huán)繞晶振敷銅，然后將晶振的外殼另行接地。三是孤島(死區(qū))問(wèn)題，如果覺(jué)得很大，那就定義個(gè)地過(guò)孔添加進(jìn)去也費(fèi)不了多大的事。另外，大面積覆銅好還是網(wǎng)格覆銅好，不好一概而論。為什么呢?大面積覆銅，如果過(guò)波峰焊時(shí)，板子就可能會(huì)翹起來(lái)，甚至?xí)鹋?。從這點(diǎn)來(lái)說(shuō)，網(wǎng)格的散熱性要好些。通常是高頻電路對(duì)抗干擾要求高的多用網(wǎng)格，低頻電路有大電流的電路等常用完整的鋪銅。補(bǔ)充下：在數(shù)字電路中，特別是帶MCU的電路中，兆級(jí)以上工作頻率的電路，敷銅的作用就是為了降低整個(gè)地平面的阻抗。更具體的處理方法我一般是這樣來(lái)操作的：各個(gè)核心模塊(也都是數(shù)字電路)在允許的情況下也會(huì)分區(qū)敷銅，然后再用線把各個(gè)敷銅連接起來(lái)，這樣做的目的也是為了減小各級(jí)電路之間的影響。對(duì)于數(shù)字電路模擬電路 混合的電路，地線的獨(dú)立走線，以及到最后到電源濾波電容處的匯總就不多說(shuō)了，大家都清楚。不過(guò)有一點(diǎn)：模擬電路里的地線分布，很多時(shí)候不能簡(jiǎn)單敷成一片銅皮就了事，因?yàn)槟M電路里很注重前后級(jí)的互相影響，而且模擬地也要求單點(diǎn)接地，所以能不能把模擬地敷成銅皮還得根據(jù)實(shí)際情況處理。(這就要求對(duì)所用到的模擬IC的一些特殊性能還是要了解的)

隨著集成電路輸出開(kāi)關(guān)速度提高以及PCB板密度增加，信號(hào)完整性已經(jīng)成為高速數(shù)字PCB設(shè)計(jì)必須關(guān)心的問(wèn)題之一。元器件和PCB板的參數(shù)、元器件在PCB板上的布局、高速信號(hào)的布線等因素，都會(huì)引起信號(hào)完整性問(wèn)題，導(dǎo)致系統(tǒng)工作不穩(wěn)定，甚至完全不工作。如何在PCB板的設(shè)計(jì)過(guò)程中充分考慮到信號(hào)完整性的因素，并采取有效的控制措施，已經(jīng)成為當(dāng)今PCB設(shè)計(jì)業(yè)界中的一個(gè)熱門(mén)課題。基于信號(hào)完整性計(jì)算機(jī)分析的高速數(shù)字PCB板設(shè)計(jì)方法能有效地實(shí)現(xiàn)PCB設(shè)計(jì)的信號(hào)完整性。1. 信號(hào)完整性問(wèn)題概述信號(hào)完整性(SI)是指信號(hào)在電路中以正確的時(shí)序和電壓作出響應(yīng)的能力。如果電路中信號(hào)能夠以要求的時(shí)序、持續(xù)時(shí)間和電壓幅度到達(dá)IC，則該電路具有較好的信號(hào)完整性。反之，當(dāng)信號(hào)不能正常響應(yīng)時(shí)，就出現(xiàn)了信號(hào)完整性問(wèn)題。從廣義上講，信號(hào)完整性問(wèn)題主要表現(xiàn)為5個(gè)方面：延遲、反射、串?dāng)_、同步切換噪聲(SSN)和電磁兼容性(EMI)。延遲是指信號(hào)在PCB板的導(dǎo)線上以有限的速度傳輸，信號(hào)從發(fā)送端發(fā)出到達(dá)接收端，其間存在一個(gè)傳輸延遲。信號(hào)的延遲會(huì)對(duì)系統(tǒng)的時(shí)序產(chǎn)生影響，在高速數(shù)字系統(tǒng)中，傳輸延遲主要取決于導(dǎo)線的長(zhǎng)度和導(dǎo)線周?chē)橘|(zhì)的介電常數(shù)。另外，當(dāng)PCB板上導(dǎo)線(高速數(shù)字系統(tǒng)中稱為傳輸線)的特征阻抗與負(fù)載阻抗不匹配時(shí)，信號(hào)到達(dá)接收端后有一部分能量將沿著傳輸線反射回去，使信號(hào)波形發(fā)生畸變，甚至出現(xiàn)信號(hào)的過(guò)沖和下沖。信號(hào)如果在傳輸線上來(lái)回反射，就會(huì)產(chǎn)生振鈴和環(huán)繞振蕩。