【第Y招】多層板布線高頻電路往往集成度較高，布線密度大，采用多層板既是布線所必須，也是降低干擾的有效手段。在PCB Layout階段，合理的選擇一定層數(shù)的印制板尺寸，能充分利用中間層來(lái)設(shè)置屏蔽，更好地實(shí)現(xiàn)就近接地，并有效地降低寄生電感和縮短信號(hào)的傳輸長(zhǎng)度，同時(shí)還能大幅度地降低信號(hào)的交叉干擾等，所有這些方法都對(duì)高頻電路的可靠性有利。有資料顯示，同種材料時(shí)，四層板要比雙面板的噪聲低20dB。但是，同時(shí)也存在一個(gè)問(wèn)題，PCB半層數(shù)越高，制造工藝越復(fù)雜，單位成本也就越高，這就要求我們?cè)谶M(jìn)行PCB Layout時(shí)，除了選擇合適的層數(shù)的PCB板，還需要進(jìn)行合理的元器件布局規(guī)劃，并采用正確的布線規(guī)則來(lái)完成設(shè)計(jì)。　　【第二招】高速電子器件管腳間的引線彎折越少越好　　高頻電路布線的引線最好采用全直線，需要轉(zhuǎn)折，可用45度折線或者圓弧轉(zhuǎn)折，這種要求在低頻電路中僅僅用于提高銅箔的固著強(qiáng)度，而在高頻電路中，滿足這一要求卻可以減少高頻信號(hào)對(duì)外的發(fā)射和相互間的耦合。　　【第三招】高頻電路器件管腳間的引線越短越好　　信號(hào)的輻射強(qiáng)度是和信號(hào)線的走線長(zhǎng)度成正比的，高頻的信號(hào)引線越長(zhǎng)，它就越容易耦合到靠近它的元器件上去，所以對(duì)于諸如信號(hào)的時(shí)鐘、晶振、DDR的數(shù)據(jù)、LVDS線、USB線、HDMI線等高頻信號(hào)線都是要求盡可能的走線越短越好?！　　镜谒恼小扛哳l電路器件管腳間的引線層間交替越少越好　　所謂“引線的層間交替越少越好”是指元件連接過(guò)程中所用的過(guò)孔(Via)越少越好。據(jù)側(cè)，一個(gè)過(guò)孔可帶來(lái)約0.5pF的分布電容，減少過(guò)孔數(shù)能顯著提高速度和減少數(shù)據(jù)出錯(cuò)的可能性。

安徽專業(yè)PCB打樣相信對(duì)做硬件的工程師，畢業(yè)開(kāi)始進(jìn)公司時(shí)，在設(shè)計(jì)PCB時(shí)，老工程師都會(huì)對(duì)他說(shuō)，PCB走線不要走直角，專業(yè)PCB打樣走線一定要短，電容一定要就近擺放等等。但是一開(kāi)始我們可能都不了解為什么這樣做，就憑他們的幾句經(jīng)驗(yàn)對(duì)我們來(lái)說(shuō)是遠(yuǎn)遠(yuǎn)不夠的哦，當(dāng)然如果你沒(méi)有注意這些細(xì)節(jié)問(wèn)題，今后又犯了，可能又會(huì)被他們罵，“都說(shuō)了多少遍了電容一定要就近擺放，放遠(yuǎn)了起不到效果等等”，往往經(jīng)驗(yàn)告訴我們其實(shí)那些老工程師也是只有一部分人才真正掌握其中的奧妙，我們一開(kāi)始不會(huì)也不用難過(guò)，多看看資料很快就能掌握的。直到被罵好幾次后我們回去找相關(guān)資料，為什么設(shè)計(jì)PCB電容要就近擺放呢，等看了資料后就能了解一些，可是網(wǎng)上的資料很雜散，很少能找到一個(gè)很全方面講解的。下面這些內(nèi)容是我轉(zhuǎn)載的一篇關(guān)于電容去耦半徑的講解，相信你看了之后可以很牛x的回答和避免類似問(wèn)題的發(fā)生。老師問(wèn)： 為什么去耦電容就近擺放呢?學(xué)生答： 因?yàn)樗杏行О霃脚叮诺倪h(yuǎn)了失效的。電容去耦的一個(gè)重要問(wèn)題是電容的去耦半徑。大多數(shù)資料中都會(huì)提到電容擺放要盡量靠近芯片，多數(shù)資料都是從減小回路電感的角度來(lái)談這個(gè)擺放距離問(wèn)題。確實(shí)，減小電感是一個(gè)重要原因，但是還有一個(gè)重要的原因大多數(shù)資料都沒(méi)有提及，那就是電容去耦半徑問(wèn)題。如果電容擺放離芯片過(guò)遠(yuǎn)，超出了它的去耦半徑，電容將失去它的去耦的作用。理解去耦半徑最好的辦法就是考察噪聲源和電容補(bǔ)償電流之間的相位關(guān)系。當(dāng)芯片對(duì)電流的需求發(fā)生變化時(shí)，會(huì)在電源平面的一個(gè)很小的局部區(qū)域內(nèi)產(chǎn)生電壓擾動(dòng)，電容要補(bǔ)償這一電流(或電壓)，就必須先感知到這個(gè)電壓擾動(dòng)。信號(hào)在介質(zhì)中傳播需要一定的時(shí)間，因此從發(fā)生局部電壓擾動(dòng)到電容感知到這一擾動(dòng)之間有一個(gè)時(shí)間延遲。同樣，電容的補(bǔ)償電流到達(dá)擾動(dòng)區(qū)也需要一個(gè)延遲。因此必然造成噪聲源和電容補(bǔ)償電流之間的相位上的不一致。

一個(gè)高明的CAD工程師需要做的是：如何綜合考慮各方意見(jiàn)，達(dá)到最佳結(jié)合點(diǎn)。以下為EDADOC專家根據(jù)個(gè)人在通訊產(chǎn)品PCB設(shè)計(jì)的多年經(jīng)驗(yàn)，所總結(jié)出來(lái)的層疊設(shè)計(jì)參考，與大家共享。 PCB層疊設(shè)計(jì)基本原則 CAD工程師在完成布局(或預(yù)布局)后，重點(diǎn)對(duì)本板的布線瓶徑處進(jìn)行分析，再結(jié)合EDA軟件關(guān)于布線密度(PIN/RAT)的報(bào)告參數(shù)、綜合本板諸如差分線、敏感信號(hào)線、特殊拓?fù)浣Y(jié)構(gòu)等有特殊布線要求的信號(hào)數(shù)量、種類確定布線層數(shù);再根據(jù)單板的電源、地的種類、分布、有特殊布線需求的信號(hào)層數(shù)，綜合單板的性能指標(biāo)要求與成本承受能力，確定單板的電源、地的層數(shù)以及它們與信號(hào)層的相對(duì)排布位置。單板層的排布一般原則：A)與元件面相鄰的層為地平面，提供器件屏蔽層以及為頂層布線提供回流平面;B)所有信號(hào)層盡可能與地平面相鄰(確保關(guān)鍵信號(hào)層與地平面相鄰);C)主電源盡可能與其對(duì)應(yīng)地相鄰;D)盡量避免兩信號(hào)層直接相鄰;

1. 如果是人工焊接，要養(yǎng)成好的習(xí)慣，首先，焊接前要目視檢查一遍PCB板，并用萬(wàn)用表檢查關(guān)鍵電路(特別是電源與地)是否短路;其次，每次焊接完一個(gè)芯片就用萬(wàn)用表測(cè)一下電源和地是否短路;此外，焊接時(shí)不要亂甩烙鐵，如果把焊錫甩到芯片的焊腳上(特別是表貼元件)，就不容易查到。2. 在計(jì)算機(jī)上打開(kāi)PCB圖，點(diǎn)亮短路的網(wǎng)絡(luò)，看什么地方離的最近，最容易被連到一塊。特別要注意IC內(nèi)部短路。3. 發(fā)現(xiàn)有短路現(xiàn)象。拿一塊板來(lái)割線(特別適合單/雙層板),割線后將每部分功能塊分別通電,一部分一部分排除。4. 使用短路定位分析儀，如：新加坡PROTEQ CB2000短路追蹤儀，香港靈智科技QT50短路追蹤儀，英國(guó)POLAR ToneOhm950多層板路短路探測(cè)儀等等。5. 如果有BGA芯片，由于所有焊點(diǎn)被芯片覆蓋看不見(jiàn)，而且又是多層板(4層以上)，因此最好在設(shè)計(jì)時(shí)將每個(gè)芯片的電源分割開(kāi)，用磁珠或0歐電阻連接，這樣出現(xiàn)電源與地短路時(shí)，斷開(kāi)磁珠檢測(cè)，很容易定位到某一芯片。由于BGA的焊接難度大，如果不是機(jī)器自動(dòng)焊接，稍不注意就會(huì)把相鄰的電源與地兩個(gè)焊球短路。